FC2カウンター FPGAの部屋 AXI VDMAのMM2Sを使用してビデオ出力5(シミュレーション3)

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AXI VDMAのMM2Sを使用してビデオ出力5(シミュレーション3)

AXI VDMAのMM2Sを使用してビデオ出力4(シミュレーション2)”の続き。

(2016/05/03:修正 MM2S の設定も入っていたので、ブログ記事を書き換えました)

reg_set_axi_lite_master IP のレジスタ設定ファイル vdma_reg_set.txt にアドレスと設定値を入れて、シミュレーションを行った。
最初はAXI VDMA の MM2S の設定で、その後は、AXI4-Stream Switcher の設定がある。
試しなので、現在動作している MM2S のみで、S2MM の設定はまだない。
AXI VDMA の設定値は”AXI VDMAのレジスタ設定(Triple Frame Buffer)”を参照した。
vdma_reg_set.txt を示す。

44a00000
0000008B
44a0005c
00000000
44a00060
00000000
44a00064
00000000
44a00058
00000c80
44a00054
00000c80
44a00050
00000258
44a00030
00000003
44a000ac
00000000
44a000B0
00000000
44a000B4
00000000
44a000a8
00000c80
44a000a4
00000c80
44a000a0
00000258
44a20040
00000000
44a20044
80000000
44a20000
00000002
44a10040
00000000
44a10000
00000002
44a40000
00000000
44a40004
00000000
ffffffff


これで論理シミュレーションを行った。
reg_set_axi_lite_master IP の波形を示す。 reg_set_axi_lite_master のAXI4 Lite Master の波形を示す。
AXI_VDMA_MM2S_20_160502.png

正常に設定できるようだ。

次に、AXI VDMA の S2MM のAXI インターフェースの信号を見た。正常に画像データをフレームバッファにWrite できているようだ。
AXI_VDMA_MM2S_21_160502.png

AXI VDMA の S2MMのAXI インターフェースの信号を拡大してみたが、8 バーストのバースト転送が行われているようだ。
AXI_VDMA_MM2S_22_160502.png

AXI VDMA の MM2S が最初のフレームにスタートしないのは、VTC の fsync_out が AXI VDMA の設定を行う前にアサートされているからのようだ。VTC の fsync_out は AXI VDMA の mm2s_fsync に入っている。 mm2s_fsync が入っていないので、DMA がスタートしないようだ。
AXI_VDMA_MM2S_23_160503.png

従って、 AXI VDMA の mm2s_fsync が適切に入る2フレーム目では、AXI VDMA の mm2s 転送が行われている。
AXI_VDMA_MM2S_24_160503.png

AXI VDMA の mm2s 転送のはじめの部分を拡大してみた。
AXI_VDMA_MM2S_25_160503.png

これで、AXI VDMA の mm2s 転送は動作しているが、まだ、VGA出力には画像が出力されていない。
それは、v_axis_vid_out IP が出力していないからのようだ。 locked が 0 のままだ。
AXI_VDMA_MM2S_26_160503.png

これはもっとシミュレーションしないと出力が出ないのかもしれない?
以前は、同様の回路で出力が出ていたので、インプリメントしてやってみようと思う。

なお、AXI VDMA の mm2s のアプリケーションの書き方は、Xilinx フォーラムの AXI VDMA 設定アプリケーションのサンプルを参考にしようと思う。
  1. 2016年05月03日 04:55 |
  2. ZYBO
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